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DDR5的接收端容限測試
前面我們在介紹USB3 . 0、PCIe等高速串行總線的測試時提到過很多高速的串行總線 由于接收端放置有均衡器,因此需要進(jìn)行接收容限的測試以驗證接收均衡器和CDR在惡劣 信 號 下 的 表 現(xiàn) 。 對 于 D D R 來 說 , D D R 4 及 之 前 的 總 線 接 收 端 還 相 對 比 較 簡 單 , 只 是 做 一 些 匹配、時延、閾值的調(diào)整。但到了DDR5時代(圖5 . 19),由于信號速率更高,因此接收端也 開 始 采 用 很 多 高 速 串 行 總 線 中 使 用 的 可 變 增 益 調(diào) 整 以 及 均 衡 器 技 術(shù) , 這 也 使 得 D D R 5 測 試 中必須關(guān)注接收均衡器的影響,這是之前的DDR測試中不曾涉及的。 DDR4 和 LPDDR4 一致性測試軟件。廣西DDR一致性測試聯(lián)系人
由于DDR5工作時鐘比較高到3.2GHz,系統(tǒng)裕量很小,因此信號的 隨機(jī)和確定性抖動對于數(shù)據(jù)的正確傳輸至關(guān)重要,需要考慮熱噪聲引入的RJ、電源噪聲引 入的PJ、傳輸通道損耗帶來的DJ等影響。DDR5的測試項目比DDR4也更加復(fù)雜。比如 其新增了nUI抖動測試項目,并且需要像很多高速串行總線一樣對抖動進(jìn)行分解并評估 RJ、DJ等不同分量的影響。另外,由于高速的DDR5芯片內(nèi)部都有均衡器芯片,因此實際 進(jìn)行信號波形測試時也需要考慮模擬均衡器對信號的影響。圖5.16展示了典型的DDR5 和LPDDR5測試軟件的使用界面和一部分測試結(jié)果。陜西DDR一致性測試商家DDR、DDR2、DDR3、DDR4 調(diào)試和驗證的總線解碼器。
(2)根據(jù)讀/寫信號的幅度不同進(jìn)行分離。如果PCB走線長度比較 長,在不同位置測試時可能讀/寫信號的幅度不太一樣,可以基于幅度進(jìn)行觸發(fā)分離。但是 這種方法對于走線長度不長或者讀/寫信號幅度差別不大的場合不太適用。
(3)根據(jù)RAS、CAS、CS、WE等控制信號進(jìn)行分離。這種方法使用控制信號的讀/寫 來判決當(dāng)前的讀寫指令,是可靠的方法。但是由于要同時連接多個控制信號以及Clk、 DQS、DQ等信號,要求示波器的通道數(shù)多于4個,只有帶數(shù)字通道的混合信號示波器才能 滿足要求,而且數(shù)字通道的采樣率也要比較高。圖5.11是用帶高速數(shù)字通道的示波器觸發(fā) 并采集到的DDR信號波形。
通常我們會以時鐘為基準(zhǔn)對數(shù)據(jù)信號疊加形成眼圖,但這種簡單的方法對于DDR信 號不太適用。DDR總線上信號的讀、寫和三態(tài)都混在一起,因此需要對信號進(jìn)行分離后再進(jìn) 行測量分析。傳統(tǒng)上有以下幾種方法用來進(jìn)行讀/寫信號的分離,但都存在一定的缺點。
(1)根據(jù)讀/寫Preamble的寬度不同進(jìn)行分離(針對DDR2信號)。Preamble是每個Burst的數(shù)據(jù)傳輸開始前,DQS信號從高阻態(tài)到發(fā)出有效的鎖存邊沿前的 一段準(zhǔn)備時間,有些芯片的讀時序和寫時序的Preamble的寬度可能是不一樣的,因此可以 用示波器的脈沖寬度觸發(fā)功能進(jìn)行分離。但由于JEDEC并沒有嚴(yán)格規(guī)定寫時序的 Preamble寬度的上限,因此如果芯片的讀/寫時序的Preamble的寬度接近則不能進(jìn)行分 離。另外,對于DDR3來說,讀時序的Preamble可能是正電平也可能是負(fù)電平;對于 DDR4來說,讀/寫時序的Preamble幾乎一樣,這都使得觸發(fā)更加難以設(shè)置。 DDR4 和 LPDDR4 一致性測試應(yīng)用軟件提供了多種可以簡化設(shè)計驗證的關(guān)鍵功能。
DDR數(shù)據(jù)總線的一致性測試
DQS (源同步時鐘)和DQ (數(shù)據(jù))的波形參數(shù)測試與命令地址總線測試類似,比較簡 單,在此不做詳細(xì)介紹。對于DDR1, DQS是單端信號,可以用單端探頭測試;DDR2&3 DQS 則是差分信號,建議用差分探頭測試,減小探測難度。DQS和DQ波形包括三態(tài)(T特征,以及讀數(shù)據(jù)(Read Burst)、寫數(shù)據(jù)(Write Burst)的DQS和DQ的相對時序特征。在 我們測試時,只是捕獲了這樣的波形,然后測試出讀、寫操作時的建立時間和保持時間參數(shù) 是不夠的,因為數(shù)據(jù)碼型是變化的,猝發(fā)長度也是變化的,只測試幾個時序參數(shù)很難覆蓋各 種情況,更難測出差情況。很多工程師花了一周時間去測試DDR,卻仍然測不出問題的關(guān) 鍵點就在于此。因此我們應(yīng)該用眼圖的方式去測試DDR的讀、寫時序,確保反映整體時序情 況并捕獲差情況下的波形,比較好能夠套用串行數(shù)據(jù)的分析方法,調(diào)用模板幫助判斷。 DDR命令、地址和地址總線的建立時間和保持時間定義。自動化DDR一致性測試規(guī)格尺寸
DDR3 和 LPDDR3 一致性測試應(yīng)用軟件。廣西DDR一致性測試聯(lián)系人
實驗室配套,誤碼儀/示波器,矢量網(wǎng)絡(luò)分析儀,協(xié)議分析儀產(chǎn)業(yè)是國民經(jīng)濟(jì)的基礎(chǔ)性、戰(zhàn)略性產(chǎn)業(yè),是信息化和工業(yè)化深度融合的源頭,對促進(jìn)工業(yè)轉(zhuǎn)型升級、發(fā)展戰(zhàn)略性新興產(chǎn)業(yè)、推動現(xiàn)代**建設(shè)、保證和提高大家生活水平具有重要作用。隨著網(wǎng)絡(luò)消費的不斷遞增,而互聯(lián)網(wǎng)的商業(yè)價值不斷被挖掘出來,呈爆發(fā)式增長,傳統(tǒng)的營銷模式將逐步被取代。有限責(zé)任公司企業(yè)要抓住機(jī)遇,融入到互聯(lián)網(wǎng)發(fā)展的行業(yè)中,為行業(yè)的發(fā)展提高競爭力。儀器儀表行業(yè)已經(jīng)連續(xù)多年保持了經(jīng)濟(jì)高位運行的態(tài)勢。即使當(dāng)全球受金融風(fēng)暴的影響,各個行業(yè)經(jīng)濟(jì)東圃有所放緩,但從全景發(fā)展情況看來,儀表行業(yè)的增長速度并沒有放緩。儀器儀表行業(yè)飛速發(fā)展一是因為我國的經(jīng)濟(jì)高速穩(wěn)定發(fā)展的運行;按照過去的經(jīng)驗,如果GDP的增長在10%以上時,儀表行業(yè)的增長率則在26%~30%之間。二是因為我國宏觀調(diào)控對儀表行業(yè)的影響有一個滯后期,儀表往往在工程的后期才交付使用,因此,因宏觀調(diào)控政策而減少的收入對儀表行業(yè)的影響不會太大。廣西DDR一致性測試聯(lián)系人
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