DDR測試MIPI測試項目

來源: 發(fā)布時間:2023-06-15

由于D-PHY信號比較復雜,測試項目也很多,為了方便對D-PHY信號的分析,MIPI協(xié)會提供了一個的DPHYGUI的信號分析軟件。用戶可以用示波器手動捕獲到相應的LP或HS的信號并保存成數(shù)據(jù)文件,然后用這個軟件對波形進行分析,圖13.9DPHYGUI軟件的界面。

但需要注意的是,DPHYGUI軟件只側重于對LP或HS信號質量的分析,對于測試規(guī)范中要求的一些LP和HS狀態(tài)間切換的時序關系以及Data和Clock間時序關系的測試項目覆蓋較少。另外,使用DPHYGUI軟件做分析前,用戶需要對D-PHY的信號以及示波器的設置非常熟悉才能夠捕獲到正確的數(shù)據(jù)波形并保存下來。為了加快和方便D-PHY信號的測試,可以使用示波器廠商額外提供的針對D-PHY的信號一致性測試軟件,如Agilent公司的U7238BMIPID-PHY信號一致性測試軟件平臺,這個軟件完全覆蓋了MIPI協(xié)會的CTS對信號質量測試要求的所有項目,采用圖形化的界面指導用戶完成測試參數(shù)的設置和連接,并自動完成信號質量的測試和測試報告的生成。 MIPI 速率和幀率的關系;DDR測試MIPI測試項目

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在MIPI接口的高速接收單元中,高速比較器是部件。圖4是高速比較器的電路結構。由于輸入數(shù)據(jù)是高
速低擺幅的信號(例如140mV),比較器的輸入失調電壓有可能會引起接收數(shù)據(jù)錯誤,嚴重影響系統(tǒng)性能。
因此,該比較器增加了offset校準功能,在每次進行數(shù)據(jù)傳輸之前,對電路進行一次校準,以減小輸入失調
電壓對系統(tǒng)性能的影響。
輸入失調電壓校準是通過圖4中的CAL2模塊來實現(xiàn)。在這里,增加了iconst和itrimm兩路電流,其中ieonst
電流保持不變,itrimmm電流可通過五位控制信號進行調節(jié),在默認控制字10000時,immm電流與iconst
大小相同,對應的是沒有輸入失調的情況。

山西MIPI測試項目什么是mipi一致性測試;

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LANE管理層;

物理層規(guī)范了傳輸介質、電氣特性、IO電路、和同步機制,物理層遵守MIPIAllianceStandardforD-PHY,D-PHY為MIPI各個工作組共用標準;所有的CSI-2接收器和發(fā)射器必須支持連續(xù)的時鐘,可以選擇支持不連續(xù)時鐘;連續(xù)時鐘模式時,數(shù)據(jù)包之間時鐘線保持HS模式,非連續(xù)時鐘模式時,數(shù)據(jù)包之間時鐘線保持LP11狀態(tài)。

該組織結集了業(yè)界老牌的軟硬件廠商包括*大的手機芯片廠商TI、影音多媒體芯片領導廠商意法、全球手機巨頭諾基亞以及處理器內核領導廠商ARM、還有手機操作系統(tǒng)鼻祖Symbian。隨著飛思卡爾、英特爾、三星和愛立信等重量級廠商的加入,MIPI也逐漸被國際標準化組織所認可。DSI接口

2,MIPID-PHY測試項目

(1)DataLaneHS-TXDifferentialVoltages

(2)DataLaneHS-TXDifferentialVoltageMismatch

(3)DataLaneHS-TXSingle-EndedOutputHighVoltages(

4)DataLaneHS-TXStaticCommon-ModeVoltages

(5)DataLaneHS-TXStaticCommon-ModeVoltageMismatchΔV_CMTX(1,0)

(6)DataLaneHS-TXDynamicCommon-LevelVariationsBetween50-450MHz

(7)1.3.10DataLaneHS-TXDynamicCommon-LevelVariationsAbove450MHz

(8)DataLaneHS-TX20%-80%RiseTime

(9)DataLaneHS-TX80%-20%FallTime

(10)DataLaneHSEntry:T_LPXValue

(11)DataLaneHSEntry:T_HS-PREPAREValue

(12)DataLaneHSEntry:T_HS-PREPARE+T_HS-ZEROValue

(13)DataLaneHSExit:T_HS-TRAILValue

(14)DataLaneHSExit:30%-85%Post-EoTRiseTimeT_REOT

(15)DataLaneHSExit:T_EOTValue

(16)DataLaneHSExit:T_HS-EXITValue

(17)HSEntry:T_CLK-PREValue

(18)HSExit:T_CLK-POSTValue

(19)HSClockRisingEdgeAlignmenttoFirstPayloadBit

(ata-to-ClockSkew(T_SKEW[TX])

(21)ClockLaneHSClockInstantaneous:UI_INSTValue

(22)ClockLaneHSClockDeltaUI:(ΔUI)Value MIPI-DSI接口電路構架;

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在四條通路之間,在以2.5 Gbps/路運行時,D-PHY 1.2信號的最大吞吐量約為10 Gbps。物理層信號有兩種模式:高速(HS)模式和低功率(LP)模式。高速[HS]模式用于快速傳送數(shù)據(jù)。在系統(tǒng)處于空閑時,低功率[LP]模式用來傳送控制信息,以延長電池續(xù)航時間。HS和LP模式有不同的端接方式,系統(tǒng)應能夠動態(tài)改變端接方式,以支持這兩種模式

HS數(shù)據(jù)的速度越高,顯示器能夠支持的分辨率越高,影像的清晰度也就越好。數(shù)據(jù)速率與分辨率之間的關系,還要看一下其他幾個參數(shù)。

●像素時鐘:決定著像素傳送的速率

●刷新速率:屏幕每秒刷新次數(shù)

●色彩深度:用來表示一個像素的顏色的位數(shù)像素時鐘的推導公式如下:像素時鐘=水平樣點數(shù)x垂直行數(shù)x刷新速率。其中水平樣點數(shù)和垂直行數(shù)包括水平和垂直消隱間隔。 MIPI-DSI接口IP設計模擬部分采用定制方法;DDR測試MIPI測試項目

信號完整性測試:檢查MIPI信號傳輸?shù)目煽啃院头€(wěn)定性,包括檢測信號波形的噪聲、抖動、失真等;DDR測試MIPI測試項目

如何測試電接口信令?

數(shù)據(jù)在HS模式下傳送,在線路空閑時,發(fā)射機切換到低功率模式,以便節(jié)能。在高速(HS)模式下,差分電壓最小值是140mV,標稱值是200mV,比較大值是270mV,數(shù)據(jù)速率擴展到比較大2.5Gb/s。HS模式由兩種可能狀態(tài)組成:Differential-0(HS-0)和Differential-1(HS-1)。在低功率(LP)模式下,信令采用兩條單端線路,擺幅為1.2V,比較大運行數(shù)據(jù)速率為10Mb/s。數(shù)據(jù)+(Dp)線路和數(shù)據(jù)-(Dn)線路相互獨立。每條線路可以有兩種狀態(tài):0和1,這會導致LP模式,其有四種可能的狀態(tài):LP-00,LP-01,LP-10,LP-11。 DDR測試MIPI測試項目

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